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【产品价格】
# K$ `8 v2 ^0 U 标准版: ￥25009 E$ ]4 b' c4 S) f' q# R+ Y2 v5 I {
) _$ W7 G5 }" x
【产品定位】! K1 y7 P1 y& R4 ^
基于PCI的高速数据采集卡开发8 ?, c( Y2 M6 |- s, X+ B- a+ f
基于LVDS接口的高速数据采集处理卡；* S$ K$ [2 _4 V9 Y! H, g
算法加速卡;
+ W2 `' S J8 g/ n* ^) W
9 @" u% n- J1 m7 d' l, x+ B4 z6 {8 e: w% J
【产品特色】1 ^0 x* ]6 J* O' d+ T1 C' Z0 _
提供完整的FPGA+PCI解决方案，性能稳定,兼容性好；
, I( F: H8 s) ~3 v提供完整的参考设计,包括FPGA代码,驱动程序,应用程序等,可以作为项目开发的模板;
& h$ r! S% L8 ^1 y3 h扩展性能好，可以扩展音频输入输出卡，视频输入输出卡，高速AD，DA等。
5 Z& O8 V8 z* B6 {( ~0 g
% C i( c7 {- z( j6 `) z! U
* D& s; W, ^; ^5 s( y【产品清单】! v: U& ]3 M6 |* Y" Z
1、RPDP-PCI&LVDS开发板 1块
% J/ R1 p, U2 M1 \( m2、ByteBlasterII 下载电缆 1条
% u" }8 ?. q( K3、配套DVD光盘 1张0 c$ L2 r& P. Q. t
4 ~- K# m/ ~ }8 ~
( N+ H! X, h+ X9 Q/ ~
【硬件资源】% R9 o- y. ?! u
1、FPGA芯片：8 G) E- n2 B/ e+ M: c+ y; x! x
标准版：EP1C6Q240， 包括12,060LEs，相当于15万门左右
+ ]6 k5 e! I5 c$ k0 e+ o 增强版：EP1C12Q240，包括12,060LEs，相当于30万门左右% G4 H% A, f# C
2、配置芯片：
7 B4 C* e, g3 w! o) G 增强版：EPCS1，1Mbit储存量，支持AS和JTAG两种配置模式
- m/ s# O% x4 ^. V8 R6 [" ` 增强版：EPCS4，4Mbit储存量，支持AS和JTAG两种配置模式
( O7 v& {& @0 L j' _3、8M Byte 高速SDARM( ^5 n! y0 X& a
一片2M×32Bit SDRAM ，4个Bank，最高166MHz读写速度；& l" e# L6 M/ x. h& _0 {# m% l
4、LVDS扩展接口（DB62接口）
' ]* u }" j" T1 s$ ? r 同时提供提供：2 S r' ]! d" t3 u# j
12路LVDS信号输出；
' r& |& d& Z9 ^( l* J) O$ s/ t; @ 12路LVDS信号输入；
5 b S! D5 i/ K! R& _, f" g) V( b8 C# I 12路LVTTL信号（输入输出可编程）
; j/ r, X! u+ Q' [: k- z, E- w, N; d/ h- d- ]/ b
5、RedLogic扩展接口（VME48接口）
2 `0 N' x5 C* G2 W* V ~ 提供32路LVTTL信号，其中包括一路专用时钟输入和一路专用时钟输出.通过相应的扩展板，可以实现Video，Audio和高 速AD/DA等应用。用户也可以开发自己定义的接口板。. a9 R' K3 m$ q2 V5 E" N
( S; p% r: C% q5 C; r- o! j* H- z9 l【配套软件】
. _$ z" g0 q; y3 r) p; M: S1、 相关开发工具软件) ?" i% k2 L# K9 k( x; B d& U- @
2、 开发实例及文档- Y( |% x2 `. t4 m
3、 FPGA和ASIC设计资源库; K' p+ |" N+ b* T* _3 i: ^ |
" _6 o2 @3 e+ K, t. I
【设计文档】& o) X% d* o* N* R8 E
1、开发板用户手册
7 v- a- T1 i0 Y# Q/ |2 e4 b1 P6 B, j2、开发板原理图和PCB（Protel99SE格式）, z- A+ W& [! o1 p1 Q. k
3、QuartusII和NIOSII IDE安装指导和入门教程+ h8 `+ l V, `/ }
4、主要芯片的数据手册和仿真模型（Verilog HDL语言描述）. L; S' ?. W) p$ G- _
5 A: H4 M+ g: R5 ]& i' E. y- u【开发实例】
" O5 b$ q/ o8 |. X0 P ● BASE64解码算法
$ v8 o U" c9 {- x Base64编码 x2 v0 z5 t& ~0 _
Base64是网络上最常见的用于传输8Bit字节代码的编码方式之一，大家可以查看RFC2045～RFC2049，上面有MIME的详细规范。
8 v7 j0 a& q. o7 C; A# r Base64要求把每三个8Bit的字节转换为四个6Bit的字节（3*8 = 4*6 = 24），然后把6Bit再添两位高位0，组成四个8Bit的字节，也就是说，转换后的字符串理论上将要比原来的长1/3。
. u) `; v# O& L( k/ V3 ^ 本设计完成了BASE64解码算法的FPGA程序设计和验证。
2 j$ e9 P' p( Y" R3 E" _& W1 O1 j& w+ m' v/ C9 M
● 数据采集卡( J; V2 z8 Z8 |4 R: Q' ]
FPGA内部产生数据源，主机端程序响应pci卡发出的中断信号，将硬件板卡中的数据传入主机，并将数据在界面上显示相应的数据以及接收到的帧数。将收到的数据存入硬盘，以便查看。
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) O9 B: h8 M$ t7 `& @5 r
+ H; Q6 R$ [$ h5 l0 U& ^, q4 `. o! e9 j" T% c6 {
! M- P& E' ~3 }1 f' O
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特别声明：7 R7 e6 P" c; H
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E-Mail: dz51.com@163.com dz51123@sohu.com dz51123@sina.com sunjingyun488@sohu.com
4 K; X/ ~, t" z; M* m1 EQQ:349646210 (dz51验证) MSN:dz51.com@163.com |
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狗仔卡
发表于 10.11.2007 09:12:42
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