PCI&LVDS产品开发平台(RPDP-PCI&LVDS)

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【产品价格】
标准版: ￥2500
- r& S0 @8 L: H9 l
" }$ W( Y: B/ I) C( B【产品定位】
! n6 h4 A9 t, M' y8 Y: N基于PCI的高速数据采集卡开发
, K; d; ~: g; [1 S( T基于LVDS接口的高速数据采集处理卡；
算法加速卡;
- S, W1 p& r) F. G

【产品特色】
) \  F: a* F5 _提供完整的FPGA+PCI解决方案，性能稳定,兼容性好；
# Z9 Z6 ^! c" O提供完整的参考设计,包括FPGA代码,驱动程序,应用程序等,可以作为项目开发的模板;
扩展性能好，可以扩展音频输入输出卡，视频输入输出卡，高速AD，DA等。
2 T( m" w5 ]: @8 J2 S, }
& z- D1 K: x8 C4 R5 C  q
【产品清单】
  m; a" k2 v2 g$ E' Z% d1、RPDP-PCI&LVDS开发板       1块
2、ByteBlasterII 下载电缆    1条
' H* I( _0 L" S5 s3、配套DVD光盘               1张
1 h3 V+ y7 @+ [& p; i8 I
: X9 N) J- i; E  E) W  G
【硬件资源】
1、FPGA芯片：
! j, U1 `4 d4 a4 f- y* m% D& |      标准版：EP1C6Q240， 包括12,060LEs，相当于15万门左右
      增强版：EP1C12Q240，包括12,060LEs，相当于30万门左右
; f) `; D0 k$ J: E' L, ?9 }5 ~2、配置芯片：
0 {' q: U( f- Q4 K# n      增强版：EPCS1，1Mbit储存量，支持AS和JTAG两种配置模式
1 f- T+ s# e( W      增强版：EPCS4，4Mbit储存量，支持AS和JTAG两种配置模式
1 ]& Q: Y( d$ U' n* p% I0 C3、8M Byte 高速SDARM
      一片2M×32Bit SDRAM ，4个Bank，最高166MHz读写速度；
4、LVDS扩展接口（DB62接口）
      同时提供提供：
      12路LVDS信号输出；
      12路LVDS信号输入；
      12路LVTTL信号（输入输出可编程）
6 p& M1 b  k; H7 B0 M8 ]
5、RedLogic扩展接口（VME48接口）
  i. G5 m/ Z/ [; m  W8 b: b      提供32路LVTTL信号，其中包括一路专用时钟输入和一路专用时钟输出.通过相应的扩展板，可以实现Video，Audio和高 速AD/DA等应用。用户也可以开发自己定义的接口板。

【配套软件】
1、 相关开发工具软件
2、 开发实例及文档
( t* e5 |7 V  I0 J3、 FPGA和ASIC设计资源库

【设计文档】
1、开发板用户手册
2、开发板原理图和PCB（Protel99SE格式）
3、QuartusII和NIOSII IDE安装指导和入门教程
6 Q* ~* P, L6 V9 A. F# q( B4、主要芯片的数据手册和仿真模型（Verilog HDL语言描述）
3 ^  D" }- E, b! o
【开发实例】
# s; C1 K; c& T# ] ● BASE64解码算法
* m; X* c' d$ q; O: B( ]        Base64编码
5 d1 B* i2 {* k3 I2 y        Base64是网络上最常见的用于传输8Bit字节代码的编码方式之一，大家可以查看RFC2045～RFC2049，上面有MIME的详细规范。
' a/ R  |% G2 S6 B9 b        Base64要求把每三个8Bit的字节转换为四个6Bit的字节（3*8 = 4*6 = 24），然后把6Bit再添两位高位0，组成四个8Bit的字节，也就是说，转换后的字符串理论上将要比原来的长1/3。
% G- E8 Y* b/ E# e# A& u. U        本设计完成了BASE64解码算法的FPGA程序设计和验证。
9 ]( q0 s- L0 d
7 V* {  x6 [- Q( y; B# ` ● 数据采集卡
        FPGA内部产生数据源，主机端程序响应pci卡发出的中断信号，将硬件板卡中的数据传入主机，并将数据在界面上显示相应的数据以及接收到的帧数。将收到的数据存入硬盘，以便查看。




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2 q1 F. w) [0 x. Q电话:   010-51299598  62535108-11      FAX：010-62538108-17
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