PCI&LVDS产品开发平台(RPDP-PCI&LVDS)

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【产品价格】
7 @6 i1 G8 a6 |5 O 标准版: ￥2500
5 i1 E* M/ h2 \# M: C- I* Q1 [) n
【产品定位】
基于PCI的高速数据采集卡开发
基于LVDS接口的高速数据采集处理卡；
3 `4 o1 A1 _/ e8 Y1 M( D' I算法加速卡;


- q9 j8 m  Z$ ]' t% k5 ]+ b3 \6 ~【产品特色】
提供完整的FPGA+PCI解决方案，性能稳定,兼容性好；
提供完整的参考设计,包括FPGA代码,驱动程序,应用程序等,可以作为项目开发的模板;
% j3 S5 ^; ~6 N* D扩展性能好，可以扩展音频输入输出卡，视频输入输出卡，高速AD，DA等。
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1 \0 Q9 A9 J; p& g【产品清单】
7 r( h! P6 @3 [4 B" w9 `1、RPDP-PCI&LVDS开发板       1块
2、ByteBlasterII 下载电缆    1条
3、配套DVD光盘               1张


【硬件资源】
4 E+ `6 n) E' Y- J4 T, ^: E' s1、FPGA芯片：
1 B. s1 n( `, x, }      标准版：EP1C6Q240， 包括12,060LEs，相当于15万门左右
      增强版：EP1C12Q240，包括12,060LEs，相当于30万门左右
2、配置芯片：
      增强版：EPCS1，1Mbit储存量，支持AS和JTAG两种配置模式
4 C" F. R; L2 I( {) u      增强版：EPCS4，4Mbit储存量，支持AS和JTAG两种配置模式
! s" n# W: Q; G. t3、8M Byte 高速SDARM
      一片2M×32Bit SDRAM ，4个Bank，最高166MHz读写速度；
0 T9 D5 }: w1 `3 V- k4、LVDS扩展接口（DB62接口）
5 n4 ?+ _. E: k! r! c% ^      同时提供提供：
      12路LVDS信号输出；
+ Z- x  G9 Q# K; g) m3 {      12路LVDS信号输入；
7 K. N5 ]" [! U. V      12路LVTTL信号（输入输出可编程）
1 Q6 E4 C- S5 o4 f: Y5 R5 V- |, ~
) U# K7 O- D; G7 c, S5、RedLogic扩展接口（VME48接口）
# z0 L6 i0 g7 {  `( n' x      提供32路LVTTL信号，其中包括一路专用时钟输入和一路专用时钟输出.通过相应的扩展板，可以实现Video，Audio和高 速AD/DA等应用。用户也可以开发自己定义的接口板。

& ~: q7 D8 E* f  K; X; Z1 t【配套软件】
1、 相关开发工具软件
+ e* g$ C3 @3 v9 O2、 开发实例及文档
3、 FPGA和ASIC设计资源库

$ f0 L) }  }+ C& m  N' g【设计文档】
1、开发板用户手册
2、开发板原理图和PCB（Protel99SE格式）
& ?- z! g8 `& M/ S! r# i4 u& s3、QuartusII和NIOSII IDE安装指导和入门教程
; R9 N8 c  i7 A% ^  u9 w0 D- G4、主要芯片的数据手册和仿真模型（Verilog HDL语言描述）
$ y3 K' {' V# T
【开发实例】
● BASE64解码算法
6 Z" ^6 c; b  N        Base64编码
2 {3 s0 b! ?1 v1 f3 `; Z0 s: P0 G        Base64是网络上最常见的用于传输8Bit字节代码的编码方式之一，大家可以查看RFC2045～RFC2049，上面有MIME的详细规范。
        Base64要求把每三个8Bit的字节转换为四个6Bit的字节（3*8 = 4*6 = 24），然后把6Bit再添两位高位0，组成四个8Bit的字节，也就是说，转换后的字符串理论上将要比原来的长1/3。
        本设计完成了BASE64解码算法的FPGA程序设计和验证。

$ y' \6 |* D  ]& Q ● 数据采集卡
+ s: A9 M2 b$ C8 r* E        FPGA内部产生数据源，主机端程序响应pci卡发出的中断信号，将硬件板卡中的数据传入主机，并将数据在界面上显示相应的数据以及接收到的帧数。将收到的数据存入硬盘，以便查看。


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